基于数字移相的高精度脉宽测量系统及其FPGA实现(2)

ＳｐａｒｔａｎＩＩ系列是一款高性能、低价位的ＦＰＧＡ芯片，其最高运行频率为２００ＭＨｚ，这里选用其中的ＸＣ２Ｓ１５－６（－６为速度等级）。芯片提供了四个高精度片内数字延迟锁定环路（Ｄｅｌａｙ－Ｌｏｃｋｅｄ Ｌｏｏｐ，即ＤＬＬ），可以保证芯片内时钟信号的零传送延迟和低的时钟歪斜（Ｃｌｏｃｋ Ｓｋｅｗ）；同时可以方便地实现对时钟信号的常用控制，如移相、倍频、分频等。在ＨＤＬ程序设计中，可以使用符号ＣＬＫＤＬＬ调用片内ＤＬＬ结构，其管脚图如图４所示。主要管脚说明如下：

ＣＬＫＩＮ：时钟源输入，其频率范围为２５～１００ＭＨｚ。

ＣＬＫＦＢ：反馈或参考时钟信号，只能从ＣＬＫ０或ＣＬＫ２Ｘ反馈输入。

ＣＬＫ?眼０｜９０｜１８０｜２７０?演：时钟输出，与输入时钟同频，但相位依次相差９０°。其内部定义了属性ＤＵＴＹ＿ＣＹＣＬＥ＿ＣＯＲＲＥＣＴＩＯＮ，可以用来调整时钟的占空比，值为ＦＡＬＳＥ时，输出时钟占空比和输入时钟一致，值为ＴＲＵＥ时将占空比调整为５０％。

ＣＬＫ２Ｘ：时钟源倍频输出，且占空比自动调整为５０％。

ＣＬＫＤＶ：时钟源分频输出，由属性 ＣＬＫＤＶ＿ＤＩＶＩＤＥ控制Ｎ分频，Ｎ可以为１．５、２、２．５、３、４、５、８或１６。

ＬＯＣＫＥＤ：该信号为低电平时，