AD6620工作原理及其在中频数字化直扩接收机中的(2)
2015-11-11 02:02
导读：AD6620的微处理器接口有两种模式：MODE0与MODE1，二者可以通过mode的管脚进行选择。在MODE0模式下对内部寄存器进行写操作工作时序如图3所示。当一个写操作
AD6620的微处理器接口有两种模式：MODE0与MODE1，二者可以通过mode的管脚进行选择。在MODE0模式下对内部寄存器进行写操作工作时序如图3所示。当一个写操作执行时，RDY在WR和CS变低后立即变低，直到写数据完成后的第一个时钟的上升沿再变高。在写完一个数据后，CS必须变高后，才能进行下一个数据的写操作。在MODE1模式下对内部寄存器进行写操作工作时序如图4所示。R/W和DS变低后，开始执行一个写操作时，DTACK在数据已经被锁存后立即变低，直到DS信号变高后DTACK才变高，完成一个写操作。
初始化时如果外部控制单元控制的时钟比AD6620的主时钟低，则对时序的要求较低，外部控制单元与AD6620的主时间并不要求同步。如外部控制单元选择的工作时钟比AD6620的主时钟高，则对时序的要求很高，必须注意二者的同步关系，或者外部控制单元进行操作时要插入一些等待周期。
3 具体应用分析
在某型号的通信与定位系统中，选用AD6620与FPGA构建了直扩数字化接收机的平台，其中频数字化处理单元的组成框图如图5。其中AD6620完成数字中频信号到零中频的搬移，FPGA完成伪码的捕获、跟踪以及信号的解调，FPGA的选可根据具体需
