基于Verilog-HDL的轴承振动噪声电压峰值检测(2)

仅有图5的逻辑功能框图还不能方便地用Verilog-HDL来描述。为此将其进一步细化为图6所示的形式。图6中虚线框内的功能由XC9572（Xilinx公司的产品）实现。图6中，Vin为模拟电压的输入，VDOUT为数字峰值电压的输出，VDOUT、RB1、RB21均与接口电路相接，RB1、RB2受微机的控制。

2.2 时序图

图7为图6所示逻辑电路的时序图。按照轴承检测的工艺，当系统复位RB2、启动脉冲RB1到来后，经0.7s的延时，便产生1个宽度为1s的门脉冲G_P。在此期间，A/D转换器连续转换的数据送入数据缓冲器GET_DATA，之后进行数字信号的峰值检测和保持。A/D转换器在此采用MAX120。该转换器的分辨率为12bit，转换时间为1.6μs。

2.3 逻辑仿真