基于Z85C30的多协议串行通信设计(2)

1.3 Z85C30的接口时序

RD和WR是总线传输的两个控制信号。CE、D/C、A/B和INTACK用于控制总线传输的类型。总线上传输的地址在有效后，RD和WR才变低。CE、WR和CE、RD锁存地址的时序是一致的。

（1）读周期时序

在RD和CE有效时，A/B和D/C上的地址被锁存。在此周期内CE必须保持低，并且INTACK必须保持高。Z85X30的总线驱动设备只有在RD和CE都有效地才使能。在读操作用D/C为高时，不会影响指针的状态。当D/C为低且在内部操作完成后，指针复位到0。

（2）写周期时序

在CE和WR有效时，A/B、D/C和数据D7～D0同时被锁存。在此周期内CE必须保持低，并且INTACK必须保持高。在写操作且D/C为高时，不会影响指针的状态。当D/C为低且在内部操作完毕后，指针复位到0。

（3）中断响应周期

当INTACK为低时，进入中断响应周期。这个A/B、D/C、CE、WR信号都被忽略。

1.4 Z85X30寄存器访问

访问寄存器有两个步骤，是使用寄存器指针来完成寻址的。为寻址一个指定的寄存器，先通过写入WR0的指针位来指定寄存器。因为Z85X30只有唯一的寄存器设置存在，因此，可以从两个通道中的任意一个将指针写入。当指针写入后，再次的读或写周期（当D/C为低时）将存取刚才指定的寄存器。在读和写周期结束