MPC850中复位逻辑和CPM协议切换的CPLD实现(2)

设计时，将MPC850的复位信号（上电复位poreset、硬复位hreset、软复位sreset）连接到XC95144XL的连接方法如图2所示。

该方案中CPLD的上电复位设计过程如下：

（1） 系统上电后，上电复位poreset由XC95144XL产生，为了使MPC850得到可靠的复位，这个延迟时间通常比要求的3μs要大一些。MODCK配置可一直固定。

（2） poreset 信号无效后（为高电平），MPC850会采样MODCK并驱动HRESET信号512个时钟周期。需要注意的是这个时间由MPC850控制的，CPLD不作逻辑实现。然后MPC850开始采样总线上的32bit配置数据。这时不能马上驱动总线数据线，应延迟若干时钟周期后驱动，经应用证明延迟8个时钟周期以上可以满足要求。

（3） 驱动总线配置数据16个时钟周期后把总线置为高阻态，上电复位结束。

手动复位的逻辑实现主要考虑的是对按键的复位作抗抖动处理，以防止多次短暂接触对系统造成反复复位，可以在代码中加入一个RS触发顺来实现抗抖。

本设计采用VHDL语言实现，限于篇幅代码省略。需要注意的是：在总线数据配置时，不能采用顺序执行语句，而只有应用并发语句执行才能得到正确的配置。如：

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