基于USB2.0的高速无线数传接收设备的数据接收存(2)

在数据转存系统中，ISP1581用于处理主机的高速数据传输。它工作在普通处理器接口模式下，采用8051风格的读写选通信号，由DSP芯片TMS320F206控制。两者在选定工作方式下的信号连线如图3所示，图中未画出的信号引脚可以悬空，供电引脚的连接方式在参考资料[2]第46页有简明描述。在FPGA译码逻辑的作用下，ISP1581的片内寄存器被映射在DSP的片外数据空间中。DSP通过8位地址线选择要访问的寄存器，在读写选通信号的控制下，利用16位数据线与选定的寄存器交换数据。在访问ISP1581单字节寄存器时，数据总线高字节内容无关紧要。ISP1581通过中断引脚INT向DSP报告发生的总线事件，利用D 、D-引脚完成与主机的数据交换。

3 数据转存系统的工作过程

系统加电后，当FPGA配置过程结束时，如果有串行数据输入，位同步逻辑和帧同步逻辑便启动同步过程。同时，DSP片内FLASH中复位中断服务程序c_int0()[4]被立即执行，在建立好C语言的工作环境下，它会调用主函数main()。在main()中，需要安排好一系列有先后顺序的初始化工作。其中，ISP1581的初始化过程比较复杂，需要考虑设备采用的供电方式（这里为自供电[6]方式）、插接主机和系统上电的先后次序，并需要与USB总线枚举[1][6]过程相结合。

在FPGA中的位同步逻辑和帧同步逻辑均进入同步状态，且DSP主控模块配合主机完成初始化任务后，即可启动数据的传输过程。下面介绍一下IS