基于AD9858的线性调频源设计(2)

３．２ 频率调节字的计算

设输出频率为ｆ０，相位累加器的位数为Ｎ，参考时钟为ｆＳＹＳＣＬＫ，则频率调节字为煟菠牐

ｆｔｗ＝煟妫啊粒玻危牐ｆＳＹＳＣＬＫ

３．３ 步进频率调节字的计算

设ｆＦ为终止频率，ｆＳ为起始频率，ＤＦＲＲＷ为步进频率斜率调节字，Ｔ为线性调频信号时宽，则步进频率控制字为煟长牔

ＤＦＴＷ＝（｜ｆＦ－ｆｓ｜／ｆＳＹＳＣＬＫ２）煟模遥遥遥祝Ｔ牎粒玻常

４　硬件结构

本设计利用ＡＤ９８５８上集成的锁相环来将６０ＭＨｚ的时钟信号倍频到９６０ＭＨｚ，以便使其作为ＤＤＳ的工作参考时钟，配置芯片选用Ｘｉｌｉｎｘ公司生产的ＣＰＬＤ芯片ＸＣ９５１４４ＸＬ来完成。其电路的硬件结构如图１所示。

使用ＸＣ９５１４４ＸＬ时，可按照ＡＤ９８５８数据手册上提供的时序来对图中所示的端口进行操作，以便完成对ＡＤ９８５８的配置。用６０ＭＨｚ时钟输入到ＰＦＤ端口可作为鉴频器的输入，ＶＣＯ的输出经功分器后，一路经１６分频后从ＤＩＶ端口输入作为鉴频器的输入，另一路直接从端口ＲＥＦＣＬＫ输入以作为ＤＤＳ的参考时钟。端口ＣＰ的输出经环路滤波后可作为ＶＣＯ的调谐电压。而线性调频信号则从端口ＩＯＵＴ输出，并经带通滤波器和放大器后，作为最终所需要的输出。

５　控制流程

该设计的配置芯片选用的是Ｘｉｌｉｎｘ公司的ＸＣ９５１４４ＸＬ，控制程序采用ＶＨＤＬ语言编写。设计输出的线性调频信号的起始频率为４８ＭＨｚ，终止频率为７２ＭＨｚ，时宽为２０μｓ，其控制流程如图２所示。在系统接到上电复位信号后，可依次向ＣＦＲ、ＦＴＷ、ＤＦＴＷ、ＤＦＲＲＷ写控制字，然后等待脉冲展宽信号的到来。脉冲展宽信号为外部激励信号，上升沿有效。当检测到一个上升沿之后，系统将发出一个ｕｐｄａｔｅ信号（ｕｐｄａｔｅ信号的作用是将写入寄存器的数据导入ＤＤＳ内核，同时使ＤＤＳ按照新的配置开始工作），同时计数器开始计数并输出宽度为２０μｓ的线性调频信号，同时对地址为０ｘ０２的寄存器进行操作，以将Ｂｉ