基于FPGA的智能误码测试仪

在实际工作中，常常需要误码仪能测试多种信道。但是目前市面上所销售的误码仪大多只能测试电信部门的标准通信信道，低速以一、二次群为主，高速可达ＳＤＨ信道速率；且价格昂贵、体积偏大，不能用于测试实际工作中大量存在的专用信道或自行架设的信道。这类信道多为水文监测、气象预报等特殊用途而设计，一般对传输系统的可靠性要求较高。

本文所介绍的智能误码仪在设计时特别考虑了这类信道的测试要求。它结合ＦＰＧＡ及单片机的结构特点进行编程，可在较宽的速率范围内（１５０ｂｉｔ／ｓ～２．０４８Ｍｂｉｔ／ｓ）实现智能位同步和快速码序列同步。用户不仅可以从ＬＣＤ上了解信道的误码情况，还可以通过仪器与ＰＣ机连接，在个人电脑上看到某段时间内的误码率折线图和其它误码信息，并以此来了解系统的误码发生情况。为了便于在无人值守的情况下进行误码测试，该误码仪内置了大容量的Ｅ２ＰＲＯＭ，可以保存被测系统最后４０００次的误码事件（包括时间及误码率大小）。由于设计时采用了ＦＰＧＡ、单片机等大规模集成电路，该误码仪不仅体积小巧（采用贴片元件时仅香烟盒大小），而且成本低廉、功能强大，具有较高的实用价值和市场价值。

１ 误码仪总体框图及误码测试原理

１．１ 误码仪整体结构

图１是该误码仪的整体设计框图。

ｍ序列发生模块的主要功能是根据用户的速率要求产生测试序列——ｍ序列。实际设计时，采用ＣＣＩＴＴ建议的用于低速数据传输设备测试误码的ｍ序列，其特征多项式为Ｘ９＋Ｘ５＋１，周期为５１２。在外部附件的支持下，它还可以进行多种码型变换和调制解调。

位同步模块的主要功能是从传来的码元中提取位同步信息——码元时钟煵⒔这一时钟提供给本地序列同步模块，以便在本地恢复出与测试序列同步的检验序列。

序列比较模块用于比较检验序列与测试序列的一致性。通过比较就能知道经过被测信道传输后测试序列中有多少码元产生了错误，并以此评估被测信道的性能。由于ｍ序列是周期序列，所以测试序列与检验序列的比较必须在周期的同一位置开始进行（即同相）。这也是本地序列同步模块的另一项重要功能。完成了序列比较后，序列比较模块将实时地把传输的总码元数和误码数传送给单片机。

单片机是整个误码仪的核心，它根据用户的选择控制各模块的正常工作，并根据各模块提供的状态向用户发出误码事件、状态告警、故障提示等信息。在加电时对ＦＰＧＡ进行配置也是单片机的一项重要任务。实际设计时选用了性价比极高的ＦＰＧＡ——Ａｌｔｅｒａ公司的ＦＬＥＸ１０Ｋ１０。该器件的配置文件有１５Ｋ字节，因此选用了大容量的通用单片机ＡＴ８９Ｃ５５。存储器及时钟为用户查询误码信息提供了方便，为了简化电路设计，选用了Ｉ２Ｃ总线方式的Ｅ２ＰＲＯＭ（２４ＬＣ１２８）和专用时钟芯片（ＰＣＦ８５６３）。

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在设计该误码仪时，根据ＦＰＧＡ的结构特点进行编程，采用了独特的算法，使该误码仪中位同步模块和本地序列同步模块具有较强的智能处理能力。