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高速VITERBI译码器的研究与设计

2013-11-01 01:02

全部作者： 李选中 李庆 何文浩 第1作者单位： 武汉理工大学信息工程学院 摘要： 设计了1个高速(2,1,6)Viterbi译码器，通过采用并行基-4结构和比特级进位保存算法（Carry-Save Arithmetic），改进了Viterbi算法中加-比-选单元(Add-Compare-Select Unit)的结构，消除传统行波进位加法(Ripple-Carry Adder)结构中的进位链，缩减了Viterbi译码器的关键路径，极大的降低了译码时延，从而提高译码速度，译码速度可达到200Mb/s，可用在高速数字通信的不同应用场合中。 关键词： Viterbi译码器；进位保存算法；加-比-选；高速 (浏览全文) 发表日期： 2008年03月20日 同行评议：

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综合评价： 修改稿： 注：同行评议是由特聘的同行专家给出的评审意见，综合评价是综合专家对各要素的评议得出的数值，以1至5颗星显示。