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简述ＨＤＬ的现状与发展-机电毕业论文

2013-08-26 01:06 　　关键词：ASIC 硬件描述 芯片系统
　　论文摘要：从数字系统设计的性质出发，结合目前迅速发展的芯片系统，比较、研究各种硬件描述语言；详细阐述各种语言的发展、体系结构和设计方法；探讨未来硬件描述语言的发展趋势，同时针对国内EDA基础薄弱的现状，在硬件描述语言方面作了一些有益的思考。


　　
　　现在，随着系统级FPGA以及系统芯片的出现。软硬件协调设计和系统设计变得越来越重要。传统意义上的硬件设计越来越倾向于与系统设计和软件设计结合。硬件描述语言为适应新的情况，迅速发展，出现了很多新的硬件描述语言，像Superlog、SystemC、cynlib c++等等。究交选择哪种语言进行设计，整个业界正在进行激烈的讨论。因此，完全有必要在这方面作一些比较研究，为EDA设计做一些有意义的工作，也为发展我们未来的芯片设计技术打好基础。
　　
　　1、目前HDL发展状况
　　
　　目前，硬件描述语言可谓是百花齐放，有VHDL、Superlog、Verilog、SystemC、Cynlib C++、C Level等等。虽然各种语言各有所长，但业界对到底使用哪一种语言进行设计，却莫衷一是，难有定论。
　　而比较一致的意见是，HDL和C/C++语言在设计流程中实现级和系统级都具有各自的用武之地。问题出现在系统级和实现级相连接的地方：什么时候将使用中的一种语言停下来，而开始使用另外一种语言?或者干脆就直接使用一种语言?现在看来得出结论仍为时过早。
　　在2001年举行的国际HDL会议上，与会者就使用何种设计语言展开了生动、激烈的辩论。各方人士各持己见：为Verilog辩护者认为，开发一种新的设计语言是一种浪费；为SystemC辩护者认为，系统级芯片SoC快速增长的复杂性需要新的设计方法；C语言的赞扬者认为，Verilog是硬件设计的汇编语言，而编程的标准很快就会是高级语言，Cynlib c++是最佳的选择，它速度快、代码精简；Supedog的捍卫者认为，Superlog是Verilog的扩展，可以在整个设计流程中仅提供一种语言和一个仿真器，与现有的方法兼容，是一种进化，而不是一场革命。 （科教作文网http://zw.NSEaC.com编辑发布）
　　当然，以上所有的讨论都没有提及模拟设计。如果想设计带有模拟电路的芯片，硬件描述语言必须有模拟扩展部分，像Verilog HDL－A，既要求能够描述门级开关级，又要求具有描述特性的能力。
　　
　　2、几种代表性的HDL语言
　　
　　2．1 VHDL
　　早在1980年，因为美国军事需要描述系统的方法，美国国防部开始进行VHDL的开发。1987年。由IEEE(In，stitute of Electrical and Electro－nics Engineers)将VHDL制定为标准。参考手册为IEEE VHDL语言参考手册标准草案1076/8版，于1987年批准，称为IEEE 1076－1987。应当注意，起初VHDL只是作为系统规范的一个标滞，而不足为设计而制定的。第二个版本是在1993年制定的，称为VHDL－93，增加了一些新的命令和属性。
　　虽然有“VHDL是一个4亿美元的错误”这样的说法。但VHDL毕竟是1995年以前唯一制订为标准的硬件描述语言，这是它不争的事实和优势；但同时它确实比较麻烦，而且其综合库至今也没有标准化，不具有晶体管开关级的描述能力和模拟设计的描述能力。目前的看法是，对于特大型的系统级数字电路设计，VHDL是较为合适的。
　　实质上，在底层的VHDL设计是由Verilog HDL描述的器件库支持的，因此，它们之间的互操作性十分重要。目前，Verilog和VDHL的两个国际组织OVI、Ⅵ正在筹划这一工作，准备成立专门的工作组来协调VHDL和Verilog HDL语言的互操作性。OVI也支持不需要，由VHDL到Verilog的自由表达。
　　2．2 Verilog HDL
　　Venlog HDL是在1983年，由GDA(GateWay Design Au－tomation)公司的Phil Moorby首创的。Phil Moorby后来成为Verilog－XL的主要设计者和Cadence公司的第一合伙人。在1984“1985年，Phil Moorby设计出了第一个名为Venlog－XL的仿真器；1986年，他对Verilog HDL的发展义作出了另一个巨大的贡献：提出了用于快速门级仿真的XL算法。

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　　随着Verilog－XL算法的成功，Verilog HDL语言得到迅速发展。1989年，Cadence公司收购了GDA公司，Verilog HDL语言成为Cadence公司的私有财产。1990年，Cadence公司决定公开Verilog HDL语言，于是成立了OVI(Open Verilog InternaUonal)组织，负责促进Verilog HDL语言的发展。基于Verilog HDL的优越性，IEEE于1995年制定了Verilog HDL的IEEE标准，即Verilog HDL 1364－1995；2001年发布了Verilog HDL 1364－2001标准。在这个标准中，加入了Verilog HDL－A标准，使Verilog有了模拟设计描述的能力。
　　2．3 Superlog
　　开发一种新的硬件设计语言，总是有些冒险，而且未必能够利用原来对硬件开发的经验。能不能在原有硬件描述语言的基础上，结合高级语言c、c++甚至Java等语言的特点，进行扩展，达到一种新的系统级设计语言标准呢?
　　Superlog就是在这样的背景下研制开发的系统级硬件描述语言。Verilog语言的首创者Phil Moorby和Peter Flake等硬什描述语言专家，在一家叫Co－Design Automation的EDA公司进行合作，开始对Verilog进行扩展研究。1999年，Co－Design公司发布了SUPERLOGTM系统设计语言，同时发布了两个开发工具：SYSTEMSIMTM和SYSTEMEXTM。一个用于系统级开发，一个用于高级验证。2001年，Co－Design公司向电子产业标准化组织Accellera发布了SUPERLOG扩展综合子集ESS，这样它就可以在今天Verilog语言的RTL级综合子集的基础上，提供更多级别的硬件综合抽象级，为各种系统级的EDA软件工具所利用，
　　至今为止。已超过15家芯片设计公司用Superlog来进行芯片设计和硬件开发。Superlog是一种具有良好前景的系统级硬件描述语言。但是不久前，由于整个IT产业的滑坡，EDA公司进行大的整合，Co－Design公司被Synopsys公司兼并，形势又变得扑朔迷离。　　2．4 SystemC
　　随着半导体技术的迅猛发展，SoC已经成为当今集成电路设计的发展方向。在系统芯片的各个设计中，像系统定义、软硬件划分、设计实现等，集成电路设计界一直在考虑如何满足SoC的设计要求，一直在寻找一种能同时实现较高层次的软件和硬件描述的系统级设计语言。
　　systemC正是在这种情况下，由Synopsys公司和CoWare公司积极响应目前各方对系统级设计语言的需求而合作开发的。1999年9月27日，40多家世界著名的EDA公司、lP公司、半导体公司和嵌入式软件公司宣布成立“开放式SystemC联盟”。著名公司Cadence也于2001年加入了systemC联盟。SystemC从1999年9月联盟建立初期的0.9版本开始更新，从1.0版到1.1版，一直到2001年10月推出了最新的2，0版。